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| 編輯推薦： |
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本书内容是基于Vivado设计套件和XUP A7板卡进行安排的，利用85个例程，详细介绍了数字逻辑实验的基本设计方法。内容由浅入深，循序渐进，学生易于接受，不仅有利于学生对理论知识的消化吸收，而且对实践操作具有直接指导意义。
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| 內容簡介： |
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本书以Xilinx公司的Vivado FPGA设计套件为基础，以Xilinx大学计划（Xilinx University Program，XUP）的Artix-7板卡为硬件平台，将数字逻辑设计与硬件描述语言Verilog HDL相结合，循序渐进地介绍了基于Xilinx Vivado的数字逻辑实验的基本过程和方法。本书主要内容包括硬件开发平台介绍、软件平台介绍、FPGA设计实例、组合逻辑电路实验、时序逻辑电路实验、数字逻辑设计和接口实验及数字逻辑综合实验。书中包含大量的设计实例，内容翔实、系统、全面。
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| 關於作者： |
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2002年7月，哈尔滨工业大学电气工程系本科毕业，获工学学士学位；2005年3月，哈尔滨工业大学深圳研究生院电力电子与电力传动专业硕士研究生毕业，获工学硕士学位；现任电工电子实验教学中心电子学实验室主任，主要从事实验教学和日常管理工作。近年来，获国家教学成果一等奖1项，获黑龙江省教学成果一等奖2项，作为主讲教师建设国家级精品课程1门，作为第二负责人完成国家级精品资源共享课立项。主持校级教学改革项目2项，参与省部级以上教学研究项目4项，主编教材1部，参编教材2部，发表教学研究文章6篇。
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| 目錄：
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目 录
第1章 硬件开发平台介绍1
1.1 Xilinx FPGA器件1
1.1.1 Xilinx公司简介1
1.1.2 Xilinx的FPGA器件系列2
1.2 Xilinx大学计划板卡5
1.3 主电路及外围接口电路6
1.4 XUP板卡测试21
第2章 软件平台介绍23
2.1 Vivado设计套件23
2.1.1 Vivado软件安装流程24
2.1.2 IP封装器、集成器和目录28
2.1.3 标准化XDC约束文件29
2.1.4 工程命令语言29
2.1.5 Vivado设计套件的启动方法30
2.1.6 Vivado设计套件的界面31
2.2 FPGA设计流程37
2.2.1 Vivado套件的设计流程37
2.2.2 设计综合流程39
2.2.3 设计实现流程42
2.3 硬件描述语言45
2.3.1 VHDL简介46
2.3.2 Verilog HDL简介49
第3章 FPGA设计实例56
3.1 基于原理图的设计实例56
3.1.1 简易数字钟实验原理56
3.1.2 实验流程57
3.2 基于Verilog HDL的设计实例80
3.2.1 设计要求80
3.2.2 实验操作步骤81
3.3 74系列IP封装设计实例91
3.3.1 IP核分类91
3.3.2 IP封装实验流程92
3.3.3 调用封装后的IP100
第4章 组合逻辑电路实验104
4.1 逻辑门电路104
4.1.1 基本及常用的逻辑门104
4.1.2 与非门电路的简单应用110
4.2 多路选择器112
4.2.1 2选1多路选择器113
4.2.2 4选1多路选择器114
4.2.3 4位2选1多路选择器117
4.2.4 74LS253的IP核设计及应用119
4.2.5 74LS151的IP核设计122
4.3 比较器123
4.3.1 4位比较器124
4.3.2 74LS85的IP核设计及应用127
4.3.3 利用数据选择器74LS151设计2位比较器130
4.4 译码器131
4.4.1 3线-8线译码器131
4.4.2 74LS138的IP核设计及应用133
4.4.3 数码管显示135
4.5 编码器142
4.5.1 二进制普通编码器142
4.5.2 二进制优先编码器144
4.5.3 74LS148的IP核设计145
4.6 编码转换器147
4.6.1 二进制-BCD码转换器147
4.6.2 格雷码转换器151
4.7 加法器152
4.7.1 半加器152
4.7.2 全加器153
4.7.3 4位加法器153
4.8 减法器157
4.8.1 半减器157
4.8.2 全减器157
4.9 乘法器159
4.10 除法器163
第5章 时序逻辑电路实验169
5.1 锁存器和触发器169
5.1.1 锁存器169
5.1.2 触发器170
5.1.3 74LS74的IP核设计及应用176
5.2 寄存器178
5.2.1 基本寄存器178
5.2.2 移位寄存器182
5.2.3 74LS194的IP核设计及应用189
5.3 计数器191
5.3.1 二进制计数器192
5.3.2 N进制计数器195
5.3.3 任意波形的实现201
5.3.4 74LS161的IP核设计及应用202
5.4 脉冲宽度调制208
5.5 时序逻辑电路综合设计210
第6章 数字逻辑设计和接口实验221
6.1 有限状态机221
6.1.1 Moore状态机和Mealy状态机221
6.1.2 有限状态机设计例程221
6.2 最大公约数234
6.2.1 GCD算法235
6.2.2 改进的GCD算法243
6.3 整数平方根247
6.3.1 整数平方根算法248
6.3.2 改进的整数平方根算法255
6.4 存储器259
6.4.1 只读存储器（ROM）259
6.4.2 分布式的存储器262
6.4.3 块存储器266
6.5 VGA控制器269
6.5.1 VGA的时序271
6.5.2 VGA控制器实例272
6.6 键盘和鼠标接口292
6.6.1 键盘293
6.6.2 鼠标297
第 章 数字逻辑综合实验306
7.1 数字钟306
7.2 数字频率计310
7.3 电梯控制器314
7.4 波形发生电路320
7.5 超声波测距仪332
7.6 手机电池保护板337
附录A Basys3电路图349
附录B 引脚约束356
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前 言
在过去的几十年中，随着半导体工艺和处理器技术的高速发展，数字电路设计经历了革命性的发展。作为全球领先的可编程逻辑器件及完整解决方案的供应商，美国的Xilinx公司于2012年发布了新一代FPGA设计套件Vivado，其设计环境和设计方法与上一代ISE设计套件相比发生了重大变化。Vivado侧重基于知识产权（Intellectual Property，IP）核的设计方法，允许用户根据需要选择不同的设计策略，大大提高了FPGA的设计效率。
随着全开放、自主实验教学模式的改革，传统的拘泥于实验室里的数字逻辑实验面临巨大的挑战。目前，国内外很多著名高校不断跟进技术的发展，基于新型的FPGA实验平台开展数字逻辑等课程的教学和实验。Xilinx大学计划（Xilinx University Program，XUP）针对高校师生推出一系列入门级的FPGA板卡，其中XUP A7板卡专门针对Vivado Design Suite而设计，具有Xilinx Artix-7 FPGA架构，也称为口袋实验室。每位学生都可以拥有一套低成本的FPGA板卡，能够随时随地地验证理论课程的教学内容，并将自己的设计或创意在板卡上运行，有利于培养学生的自学能力、实践能力和创新能力。
本书内容是基于Vivado设计套件和XUP A7板卡进行安排的，利用85个例程，详细介绍了数字逻辑实验的基本设计方法。内容由浅入深，循序渐进，学生易于接受，不仅有利于学生对理论知识的消化吸收，而且对实践操作具有直接指导意义。每章内容要点如下。
（1）第1章主要介绍Xilinx公司的FPGA器件系列，以及XUP A7板卡的主电路和外围接口电路。
（2）第2章通过对比原来采用的ISE设计套件，介绍了Vivado设计套件的功能和特性、Vivado软件安装流程和启动方法、Vivado设计套件的界面、标准化XDC约束文件等内容。在此基础上，介绍了FPGA的设计流程，包括设计综合和设计实现流程。最后介绍了VHDL和Verilog HDL两种常见的硬件描述语言。
（3）第3章通过设计实例介绍基于Vivado进行FPGA设计的三种基本方法，分别是基于原理图的设计实例、基于Verilog HDL语言的设计实例和74系列IP封装设计实例。
（4）第4章主要介绍了基于Vivado的组合逻辑电路实验，包括逻辑门电路、多路选择器、比较器、译码器、编码器、编码转换器、加法器、减法器、乘法器和除法器等实验内容。
（5）第5章主要介绍了基于Vivado的时序逻辑电路实验，包括锁存器、触发器、寄存器、计数器、脉冲宽度调制及时序逻辑电路综合设计等实验内容。
（6）第6章主要介绍了数字逻辑电路和接口实验，包括有限状态机、最大公约数、整数平方根、存储器、VGA控制器、键盘和鼠标接口等实验内容。
（7）第7章主要介绍了数字逻辑综合实验，包括数字钟、数字频率计、电梯控制器、波形发生电路、超声波测距仪和手机电池保护板。
本书吸取了哈尔滨工业大学电工电子实验教学中心教师的实践教学经验，并在大家的支持与指导下完成，廉玉欣负责全书的统筹规划和文字润饰。第1章、第2章、第3章由廉玉欣完成，第4章、第5章、6.1节～6.5节由侯博雅完成，第7章由王猛完成，侯云鹏完成了6.6节、附录及部分实验验证内容。
本书的撰写得到了Xilinx大学计划亚太区经理陆佳华先生和依元素科技有限公司陈俊彦经理及仝信、黄磊、于勇等多位工程师的大力支持和帮助，他们为本书的编写提供了大量的资料和硬件平台，向各位致以衷心的谢意！
由于FPGA技术发展迅速，编者水平有限，书中难免有错误和不妥之处，敬请读者提出宝贵意见，以便于本书的修订和完善。
编著者
2016年3月于哈尔滨工业大学
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